YuhangQ/atpg-ls
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YuhangQ 87b8d2ab6c 完成 flip 的逻辑
2023-02-19 19:42:50 +08:00
.gitignore
删除 .vscode
2023-02-11 21:53:52 +08:00
atpg
完成 flip 的逻辑
2023-02-19 19:42:50 +08:00
c432.bench
完成了读入部分和电路数据结构的设计和实现
2023-02-11 21:52:59 +08:00
circuit.cpp
完成 flip 的逻辑
2023-02-19 19:42:50 +08:00
circuit.h
完成 flip 的逻辑
2023-02-19 19:42:50 +08:00
crun
完成 flip 的逻辑
2023-02-19 19:42:50 +08:00
gate.cpp
完成 flip 的逻辑
2023-02-19 19:42:50 +08:00
ls.cpp
完成 flip 的逻辑
2023-02-19 19:42:50 +08:00
main.cpp
完成 flip 的逻辑
2023-02-19 19:42:50 +08:00
makefile
更高效的文件解析
2023-02-12 16:22:32 +08:00
output.txt
完成 flip 的逻辑
2023-02-19 19:42:50 +08:00
parser.cpp
完成 flip 的逻辑
2023-02-19 19:42:50 +08:00
README.md
first commit
2023-02-11 19:09:08 +08:00
res.txt
更高效的文件解析
2023-02-12 16:22:32 +08:00

README.md

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Description
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Readme 129 MiB
Languages
Verilog 49.1%
C++ 46.1%
Makefile 4.2%
Python 0.4%
Shell 0.2%